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åˆã‚ã¦ã§ã‚‚使ãˆã‚‹Verilog HDL文法ガイド ―― 記述スタイル編
ã“ã“ã§ã¯ï¼ŒVerilog HDLã®æ–‡æ³•ã«ã¤ã„ã¦ãŠã•ã‚‰ã„ã™ã‚‹ï¼ŽVerilog HDL 2001ã§ã¯ï¼Œãã‚Œã¾ã§æ–‡æ³•çš„ã«ã‚ã„ã¾ã„ã¨ã•ã‚Œã¦ããŸéƒ¨åˆ†ãªã©ãŒä¿®æ£ã•ã‚Œã¦ã„る．記述スタイルã«ã¤ã„ã¦Verilog HDL 2001ã§æ”¹å®šã•ã‚ŒãŸéƒ¨åˆ†ã‚’説明ã™ã‚‹ï¼Ž （編集部） Verilog HDLã¯ï¼Œ1995å¹´ã«IEEE 1364ã¨ã—ã¦æ¨™æº–化ã•ã‚Œã¾ã—ãŸãŒï¼Œãã®å¾Œã•ã¾ã–ã¾ãªä¿®æ£ã¨æ‹¡å¼µãŒè¡Œã‚れ，2001å¹´ã«IEEE 1364-2001ã¨ã—ã¦æ–°ã—ã„標準ã«ãªã‚Šã¾ã—ãŸï¼Žæ—¢å˜ã®æ©Ÿèƒ½ã‚‚ãã®ã¾ã¾ä½¿ãˆã‚‹ã‚ˆã†ã«ï¼Œä»•æ§˜è¿½åŠ ã®å½¢ã§æ”¹è¨‚ã•ã‚Œã¦ã„ã¾ã™ï¼Ž ãã“ã§ï¼Œæ–°ãŸã«HDLè¨è¨ˆã‚’始ã‚ã‚‹æ–¹ã§ã‚‚ã‚ã‹ã‚‹ã‚ˆã†ã«ï¼ŒVerilog HDL 2001ã®æ–‡æ³•ã‚’「記述スタイル編ã€ã¨ã€Œæ–‡æ³•ã‚¬ã‚¤ãƒ‰ç·¨ã€ã«åˆ†ã‘ã¦è§£èª¬ã—ã¾ã™ï¼ŽãªãŠï¼Œè¨˜è¿°ã‚¹ã‚¿ã‚¤ãƒ«ç·¨ã§ã¯ï¼Œæ–°æ—§ä¸¡æ–¹ã®ã‚¹ã‚¿ã‚¤ãƒ«ãŒå¯èƒ½ãªå ´åˆã«ã¯ä½µè¨˜ã›ãšï¼Œæ–°ã‚¹ã‚¿ã‚¤ãƒ«ã®ã¿ã‚’紹介ã—ã¦ã„ã¾ã™ï¼Žæ–‡æ³•ã‚¬ã‚¤ãƒ‰ç·¨ã§ã¯ä¸¡æ–¹ã‚’併記ã—ã¦ã„ã¾ã™ï¼Ž
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