KirIn 落書き帳

素人がプログラミング, FPGA, LSIをお勉強しているメモ書きです。間違いがあればご指導していただけたら幸いです。

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Vivado HLS 勉強　その0

Vivado HLS FPGA

そろそろ高位合成にも手を出さなければということで、その準備 とりあえずチュートリアルで手を動かします。 参考資料 Vivado Design Suite ユーザー ガイド 高位合成 Vivado Design Suite Tutorial High-Level Synthesis UG871 (v 2014.1) May 6, 2014 ソー…

Altera SoC EDSをインストール

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参考URL Altera SoC Embedded Design Suite User Guide ARM DS-5 Community Edition CentOS7にAltera SoC EDSをインストールします。

CentOS7にQuartusをインストール

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QuartusがDE0(CycloneⅢ）のサポートをやめて大分経ちました。 サポートされていた最後のバージョン(13.1?)をCentOS 7にCUIで再インストールします。

Python3でVerilog用画像入力テストベンチ自動生成

python verilogHDL FPGA

Verilogでグレイスケール画像群を読み込みモジュールに1画素ずつストリームに転送するためのテストベンチ、hexファイル、Makefileを自動生成するpythonスクリプトを作成しました。(ゴリ押しですが...) 画像群をROMに格納して自分のモジュールにinputします。