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形式的検証の英語

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英訳・英語 Formal verification


コンピューター用語辞典での「形式的検証」の英訳

形式的検証

読み方 ケイシキテキケンショウ

formal verification


「形式的検証」の部分一致の例文検索結果

該当件数 : 19



例文

形式的検証方法例文帳に追加

FORMAL VERIFICATION METHOD - 特許庁

形式的検証装置および方法例文帳に追加

DEVICE AND METHOD FOR FORMAL VERIFICATION - 特許庁

形式論理検証装置および形式論理検証方法例文帳に追加

DEVICE AND METHOD FOR FORMAL LOGIC VERIFICATION - 特許庁

論理回路の機能を検証する形式的検証中に強制終了した場合に、それまでの検証結果を残すことで、検証効率を向上する。例文帳に追加

To improve verification efficiency by remaining result of the verification so far when termination is forced during formal verification which verifies function of logical circuit. - 特許庁

上位設計でも形式検証を効果に導入でき、高速で検証確度の高い機能検証環境を構築する半導体集積回路の設計検証装置、方法及び記憶媒体を提供する。例文帳に追加

To provide a design verifying device for a semiconductor integrated circuit which effectively introduces form verification even in high order design and constructs a fast function verification environment with high verification accuracy and to provide its method and a recording medium. - 特許庁

したがって、検証装置のメモリ不足等により形式的検証が途中で強制終了した場合にも、上述した影響度に基づいて途中までの検証結果を残すことができる。例文帳に追加

Thus, even if the formal logical verification is forced termination by insufficient memory of a verification device, result of the verification so far can be remained according to the influence degree. - 特許庁

例文

プログラムの記述内容を形式手法による検証が可能な形式仕様に変換した回路記述の検証を簡便ならしめることができる回路記述の抽象化装置及び検証装置、回路記述の抽象化プログラム及び検証プログラム、並びに回路記述の抽象化方法及び検証方法を提供する。例文帳に追加

To provide an abstraction device and a verification device of circuit description, an abstraction program and a verification program of the circuit description, and an abstraction method and a verification method of the circuit description, allowing facilitation of verification of the circuit description converted into a formal specification, wherein description contents of a program can be verified by a formal technique. - 特許庁

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日英・英日専門用語辞書での「形式的検証」の英訳

形式的検証


Weblio英和対訳辞書での「形式的検証」の英訳

形式的検証

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Weblio例文辞書での「形式的検証」に類似した例文

形式的検証

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「形式的検証」の部分一致の例文検索結果

該当件数 : 19



例文

マルチレベル・タイミング・シミュレータにおける形式信号相互作用モデリングによる統計タイミング検証と遅れ障害検出例文帳に追加

statistical timing verification and delay fault detection by formal signal interaction modeling in a multi-level timing simulator発音を聞く  - コンピューター用語辞典

状態数が多く、状態遷移が複雑な回路に対しても、形式論理検証可能な回路を提供し、効率良くかつ高精度の論理検証可能な回路設計を行う。例文帳に追加

To perform circuit design for achieving highly efficient and precise logical verification by providing a circuit capable of achieving formal logical verification even to a circuit with the large number of states and complicate state transition. - 特許庁

これらの形式にこだわらず、記載すべき事項が漏れなく明文化され、取締役会等の承認を受け、組織内に周知徹底され、金融円滑化の実効な管理態勢が整備されているか否かを実証検証する。例文帳に追加

The inspector should empirically review, regardless of the form of rules, whether or not the rules exhaustively stipulate necessary matters and are fully disseminated throughout the organization, upon approval by the Board of Directors, thus ensuring an effective management system of Financial Support.発音を聞く  - 金融庁

形式言語の初歩者も容易に明細を作成でき、視覚モデル上でシミュレーションなどの検証を可能にする視覚明細支援ツール及び明細方法を提供する。例文帳に追加

To provide an assistant tool and a method for visual detailing which enables even a beginner of a format language to easily generate details and can verify simulation, etc., on a visual model. - 特許庁

内部管理態勢のあり方は検査対象先の姿勢を把握する上で重要な要素であることを踏まえ、形式な管理体制のみならず、その有効性及び実効性についても深度ある検証を行う。例文帳に追加

As a firm’s internal control system is an important element in assessing the basic posture of the firm, the Commission will verify the effectiveness of its functioning.発音を聞く  - 金融庁

2次双曲線群を用いた暗号化・複合化装置においてどのような装置構成、ファイル構成、及び文字形式を採用すれば実用であるのか検証する。例文帳に追加

To verify what device configuration, file configuration, and character form should be employed for the practicality of an encryption/decryption device using second-order hyperbola groups. - 特許庁

これによって、この入力信号を少ない値に設定することにより、この信号cnt_val1、cnt_val2、cnt_val3、cnt_val4と比較を行なうカウンタの状態数を減らして形式論理検証を行なう。例文帳に追加

Thus, it is possible to achieve formal logical verification by reducing the number of states of a counter which compares count values with the signals cnt_val1, cnt_val2, cnt_val3 and cnt_val4. - 特許庁

例文

試験者は、UMLモデリングツール50(以下、ツール50)を介して、検証方法を表すテスト仕様を例えばシーケンス図の形式で視覚に認識可能に作成することができる。例文帳に追加

Test specification showing a verification method can be created by an examiner so as to be visually recognizable, for example, in the format of a sequence figure through a UML modeling tool 50 (tool 50). - 特許庁

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